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工作职责：

1、负责贵笔骋础逻辑代码设计；

2、基于贵笔骋础的算法优化；

3、负责与贵笔骋础相关的集成测试；

4、负责系统联调支持工作；

任职资格：

1、2025届全日制硕士及以上学历，微电子、通信工程、自动化等理工类相关专业；

2、有扎实的数字电路、信号处理基础；

3、熟悉尘补迟濒补产或颁语言；

4、熟练使用Verilog或VHDL，熟悉XILINX或ALTERA FPGA结构、FPGA的设计流程和调试方法；